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ZL30256LFG7

Name: Microchip ZL30256LFG7
Brand: Microchip Technology
SKU: 579-ZL30256LFG7
Price: 32151 CLP
Availability: OutOfStock

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Mouser N.º:

579-ZL30256LFG7

Fabricante N.º:

ZL30256LFG7

Fabricante:

Microchip Technology

Descripción:

Sintetizador de reloj / depurador de fluctuación Dual Channel Jitter Attenuator

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Hoja de datos:

ZL30256LFG7 Hoja de datos (PDF)

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Cantidad	Precio unitario	Precio ext.
	$32.151	$32.151
	$26.784	$669.600
	$26.548	$2.654.800

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Atributo del producto	Valor de atributo	Seleccionar atributo
Fabricante:	Microchip
Categoría de producto:	Sintetizador de reloj / depurador de fluctuación
RoHS:
Número de salidas:	18 Output
Frecuencia de salida máx.:	1.045 GHz
Nivel de salida:	CMOS, HCSL, HSTL, LVDS, LVPECL
Nivel de entrada:	CMOS
Paquete / Cubierta:	LGA-80
Frecuencia de entrada máxima:	900 MHz
Voltaje de alimentación - Mín.:	1.71 V
Voltaje de alimentación - Máx.:	3.465 V
Temperatura de trabajo mínima:	- 40 C
Temperatura de trabajo máxima:	+ 85 C
Estilo de montaje:	SMD/SMT
Empaquetado:	Tray
Marca:	Microchip Technology
País de ensamblaje:	Not Available
País de difusión:	Not Available
País de origen:	TW
Sensibles a la humedad:	Yes
Corriente de suministro operativa:	296 mA, 422 mA
Dp - Disipación de potencia :	1.3 W
Producto:	Jitter Attenuators
Tipo de producto:	Clock Synthesizers / Jitter Cleaners
Cantidad de empaque de fábrica:	176
Subcategoría:	Clock & Timer ICs
Tipo:	General-Purpose
Peso de la unidad:	190 mg

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USHTS:: 8542390090
ECCN:: EAR99

ZL30256 General Purpose Jitter Attenuator

Microsemi / Microchip ZL30256 General Purpose Jitter Attenuator is a multi-channel high-performance, any-rate multiplier and jitter attenuator. The device simplifies board design by generating ultra-low-jitter clock signals from or attenuating clock signals while generating additional independent frequency families. With 3 independent jitters attenuating DPLL channels, it provides the ability to create 5 different frequency families. The Microsemi / Microchip ZL30256 offers best-in-class jitter performance and can create complete clock trees. This feature improves design reliability, reduces the bill of materials (BOM) cost, and simplifies the design by replacing multiple PLLs and peripheral timing components.