EPM240T100C3N

Altera
989-EPM240T100C3N
EPM240T100C3N

Fabricante:

Descripción:
Dispositivos lógicos programables complejos (CPLD)

Hoja de datos:
Modelo ECAD:
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En existencias: 142

Existencias:
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Plazo de entrega de fábrica:
6 Semanas Tiempo estimado de producción de fábrica para cantidades superiores a las que se muestran.
Mínimo: 1   Múltiples: 1
Precio unitario:
$-
Precio ext.:
$-
Est. Tarifa:

Precio (CLP)

Cantidad Precio unitario
Precio ext.
$35.930 $35.930
$34.754 $173.770

Atributo del producto Valor de atributo Seleccionar atributo
Altera
Categoría de producto: Dispositivos lógicos programables complejos (CPLD)
RoHS:  
EPM240
SMD/SMT
TQFP-100
2.5 V, 3.3 V
192 Macrocell
80 I/O
0 C
+ 70 C
304 MHz
4.7 ns
Tray
Marca: Altera
Tipo de memoria: Flash
Sensibles a la humedad: Yes
Cantidad de bloques de secuencias lógicas - LAB: 24
Cantidad de elementos lógicos: 240
Corriente de suministro operativa: 55 mA
Tipo de producto: CPLD - Complex Programmable Logic Devices
Cantidad de empaque de fábrica: 90
Subcategoría: Programmable Logic ICs
Voltaje de alimentación - Máx.: 3.6 V
Voltaje de alimentación - Mín.: 2.375 V
Total de memoria: 8192 bit
Nombre comercial: MAX II
Alias de las piezas n.º: 974601
Peso de la unidad: 600 mg
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Atributos seleccionados: 0

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CNHTS:
8542319090
CAHTS:
8542390000
USHTS:
8542390090
JPHTS:
854239099
TARIC:
8542399000
MXHTS:
8542399901
ECCN:
EAR99

SoC FPGA Family

Altera SoC FPGAs integrate an Arm-based hard processor system (HPS) consisting of processors, peripherals, and memory interfaces with the FPGA fabric using a high-bandwidth interconnect backbone. The devices combine the performance and power savings of hard intellectual property (IP) with the flexibility of programmable logic. These user-customizable Arm-based SoC FPGAs are ideal for reducing system power, cost, and board size by integrating discrete processors and digital signal processing (DSP) functions into a single FPGA. They differentiate the end product with custom hardware and software and add support for virtually any interface standard or protocol in the FPGA.

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